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Aplicando as Leis de Kirchhoff e anotar os passos realizados
Considerar o circuito da Figura 2 como arquitetura inicial para o gerador de sinal de RESET, em que a tensão no capacitor é de 0V todas as vezes que o circuito é ligado e que, com o passar do tempo, a tensão aumenta tendendo a +5V (padrão TTL – Transistor-Transistor Logic). Pelo padrão TTL, o nível lógico baixo garantido está localizado entre 0V e 0,8V e o nível lógico alto garantido localizado entre 2,0V e 5,0V. Discutir com seu grupo de trabalho sobre o comportamento deste circuito anotando os resultados da discussão.
Verifica a imagem no google, digite Etapa 3 ATPS
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